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Publisher: "2017 IEEE SOI-3D-Subthreshold Microelectronics Unified Conference, S3S 2017"

Subtipo de publicación

Conference Object(1)

Área temáticas

Física aplicada(1)

Área de conocimiento

Ingeniería electrónica(1)

Año de Publicación

Origen

Palabras Claves

carry skip adder(1)

dual mode logic (DML)(1)

Energy-delay tradeoffs of low-voltage dual mode logic in 28nm FD-SOI

Conference Object

Abstract: In this paper, the Dual Mode Logic (DML) technique is evaluated on a low-voltage 16-bit Carry Skip A

Palabras claves:

carry skip adder, dual mode logic (DML), Low-voltage

Fish A., Levi I., Marco Lanuzza, Ramiro Taco